Flash-Talk: Bits & Bytes rund um die SSD
Preissteigerungen, Pleiten, neue Fabs, mehr Bits pro Zelle durch geteilte Zellen und Microsofts neue Bitlocker-Strategie.
TLC-Flash mit drei Bit Fassungsvermögen pro Zelle wird von Profis für einige Anwendungen noch favorisiert, doch das langsamere und günstigere vierbittige QLC-Flash ist für die meisten Aufgaben völlig ausreichend. Die nächste Inkarnation PLC (Penta Level Cell) soll fünf Bit pro Zelle fassen, doch noch hat kein Hersteller ein kommerzielles Produkt entwickelt. Das Problem dabei ist wohl weniger die reine Speicherdichte, sondern vielmehr die sinkende Zuverlässigkeit beim Auslesen immer enger beieinanderliegender Spannungszustände.
SK Hynix kommt nun erneut mit dem Vorschlag einer geteilten Speicherzelle, auch Multi Site Cell genannt (MSC). Die Idee dahinter: Statt die Zahl der Spannungszustände innerhalb einer einzelnen Speicherzelle zu erhöhen, teilt SK Hynix eine 3D-NAND-Zelle in zwei voneinander getrennte Bereiche. Die Kombination dieser beiden Bereiche erreicht dann den Zellwert: Eine Multiplikation von zwei Teilzellen mit jeweils sechs verschiedenen Spannungsleveln ergibt eine Zelle mit 36 Werten; da passen fünf Bit hinein.
Der Controller kann diese sechs Level wesentlich besser auseinanderhalten als eine PLC-Zelle, bei der er 32 verschiedene Spannungslevel unterscheiden müsste. Da die Mehrfachzellen jedoch nicht größer werden dürften als übliche Flash-Zellen, wird wohl die Anzahl der Ladungsträger in einer Teilzelle geringer werden – das wiederum wirkt sich eventuell auf die Haltbarkeit aus. Wenn die Hersteller dies in den Griff bekommen, könnten sich solche Mehrfachzellen durchsetzen; vielleicht sogar mit zusätzlichen Spannungsebenen und damit einer höheren Bitzahl pro Zelle. Bereits 2022 hatte SK Hynix von einer MSC mit jeweils acht verschiedenen Spannungsebenen gesprochen, die damit sechs Bit speichern könnte.
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